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當今的算法主要是軟硬件算法兩大路徑：使用cpu來驅動算法，雖然部署簡便，但由于cpu發(fā)展面臨瓶頸，時延難以突破，因此缺乏市場競爭力，硬件算法方式需要開發(fā)商基于it系統(tǒng)進行設計和架構，雖然因一定程度解決時延問題具備較強的競爭力，但成本高且交付周期長，潛在風險大；而從軟件算法轉換成硬件方式，門檻則非常高。
如何困擾當今眾多廠商面臨的這些挑戰(zhàn)、幫助客戶無需硬件開發(fā)就可以達到微秒級的低時延要求？
賽靈思推出的 alveo smartnic sn1000加速卡就是這樣一個開箱即用的加速算法解決方案。
2×100gb的alveo sn1000是業(yè)界硬件可組合式smartnic，符合數(shù)據(jù) 封裝的尺寸需求，而功耗僅為75瓦。sn1000采用16核nxp arm soc構建，ultrascale+ fpga架構、arm的子系統(tǒng)以及可編程的viits networking等特性，可滿足市場不斷變化的需求。
由于預行了硬件加速，sn1000 smartnic稍加配置即可對遠程存儲、nvme或其他流量以及安和防火墻進行加速，實現(xiàn)了開箱即用、即插即用，同時維持相關性能不變。
sn1000 的另一個特性是，可以非常方便地移除預制某些功能，然后基于其統(tǒng)一軟件平臺vitis新打造的vitis networking，使用類似p4這樣的語言對數(shù)據(jù)面進行編程，也可以使用c和c++的語言對于arm進行控制和流量的管理，滿足客戶自認為非常重要的應用領域。無論是配置還是加速，均可由賽靈思或客戶來實現(xiàn)，亦可由客戶的客戶或 的軟件和ip合作伙伴來實現(xiàn)。這體現(xiàn)了賽靈思所提供的的可編程的靈。
端口輸入數(shù)據(jù)寄存器(gpiox_idr) 端口輸出數(shù)據(jù)寄存器(gpiox_odr) 其中crl 控制高8位的 io crh 低8這兩個實質是一樣的。對照我們avr來看gpiox_crl就相當于ddrx ,gpiox_odr就相當于portx,gpiox_odr就相當于pinxstm32的 io 口可以由 口可以由 軟件配置成 軟件配置成 軟件配置成 8種模式: 種模式: stm32單片機TLP7820(TP4,E(O TC4424AVPA FP75R12KT3 AD5228BUJZ10-RL7 AD5259BRMZ10-R7 AD5162BRMZ10 AD7691BRMZ ADS7822E/2K5 ADG704BRMZ ADE7953ACPZ ADG884BRMZ SY7301AADC SY8009BABC OB2225NCPA OB3330XCPA OB3636AMP SY8201ABC SY8113IADC SY6301DSC SGM2019-ADJYN5G/TR SGM4917AYTQ16G/TR SY8089A1AAC SY7208CABC SY7072AABC SGM9114YN6G/TR SGM9113YC5G